INFORMACIÓN
El 74LS32 es un circuito integrado que contiene cuatro compuertas lógicas OR de dos entradas cada una. Es decir, es un dispositivo que implementa la función lógica OR cuatro veces, y cada compuerta OR tiene dos entradas y una salida. En términos sencillos, la salida de cada compuerta OR será alta (1 lógico) si al menos una de sus dos entradas es alta (1 lógico), y será baja (0 lógico) si ambas entradas son bajas (0 lógico).
Se utiliza en diversas aplicaciones donde se requiere implementar operaciones lógicas OR, como en sistemas de control, procesamiento de señales digitales y lógica combinacional. Por ejemplo, se puede usar para encender un relé si cualquiera de varios sensores de presencia conectados a las entradas están activos, o para combinar señales de diferentes fuentes.
ESPECIFICACIONES Y CARACTERÍSTICAS
- Tipo: Compuerta Lógica OR
- Matrícula: 74LS32
- Familia lógica: TTL
- Encapsulado: PDIP-14
- Montaje: THT
- Pitch: 2.54 mm
- Número de pines: 14
- Número de canales: 4
- Voltaje de alimentación: 4.75 V a 5.25 V
- Corriente de consumo: 8 mA
- Temperatura de trabajo: 0 °C a 75 °C
- Dimensiones: 19.69mm x 6.60mm
- Peso: 1.5 g
DOCUMENTACIÓN Y RECURSOS
TUTORIALES
INFORMACIÓN ADICIONAL
¿Cómo funciona 74LS32 Compuerta OR?
Cuando todas sus entradas están en 0 (cero) o en BAJA, su salida está en 0 o en BAJA, mientras que cuando al menos una o ambas entradas están en 1 o en ALTA, su SALIDA va a estar en 1 o en ALTA. En otro sentido, la función de la compuerta OR efectivamente encuentra el máximo entre dos dígitos binarios, así como la función AND encuentra el mínimo. Se puede ver claramente que la salida X solamente es “0” (0 lógico, nivel bajo) cuando la entrada A como la entrada B están en “0”. En otras palabras, la salida X es igual a 0 cuando la entrada A y la entrada B son 0. Este dispositivo realiza la función booleana Y = A + B o Y = (A \ • B \) \ en lógica positiva.
Tabla de verdad de la compuerta OR
| Símbolo | Entrada (A) | Entrada (B) | Salida (Y) |
![]() |
0 | 0 | 0 |
| 0 | 1 | 1 | |
| 1 | 0 | 1 | |
| 1 | 1 | 1 |

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